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混合键合间距缩小逼近检测极限
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AI 综述
Semiconductor Engineering 2026年11月10日报道，随着混合键合互连间距逼近5 µm及以下，检测技术正逼近极限。报道指出，50 nm颗粒、表面污染和纳米级形貌变化都可能导致键合失效，而现有检测与量测手段难以区分致命缺陷与无害波动。工艺方面，CMP需将铜凹陷控制在几纳米内，并保持约0.5nm RMS的表面粗糙度。为应对挑战，厂商转向光学检测、干涉测量、AFM，以及红外、X射线、声学成像等多种手段，但键合界面下埋藏缺陷的检测仍是最大难题。报道认为，解决这些问题是实现键合芯片级真3D集成的关键。
AI 根据报道生成 · 3 小时前更新
最新进展11月10日 16:01
间距逼近5 µm以下，键合界面下埋藏缺陷检测仍是最大挑战。报道时间线
沿着报道，了解事件的不同侧面。
11月10日
- Semiconductor Engineering 芯片与封装混合键合间距缩小至 5 µm 以下，检测技术逼近极限
随着混合键合互连间距逼近 5 µm 及以下，50 nm 颗粒、表面污染和纳米级形貌变化都可能导致键合失效，而现有检测与量测手段难以区分致命缺陷与无害波动。CMP 需将铜凹陷控制在几纳米内并保持约 0.5nm RMS 粗糙度，厂商转向光学检测、干涉测量、AFM 及红外、X 射线、声学成像等手段，但键合界面下埋藏缺陷的检测仍是最大挑战。解决这些问题是实现键合芯片级真 3D 集成的关键。
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